明仕彩票appXilinx 完全集成的解决方案:探索火车和铁路的未来

发表于:07/31/2020 , 关键词: 异构处理, 无线通信
在列车及地面道旁设备上的智能性,可实现快速、安全、可靠、舒适的旅行。控制门、照明、摄像头、空调、制动器、卫生间以及显示器等需要在计算性能、实时性能和可靠性之间达到最佳平衡。 灵活地将人工智能和传感器结合到机舱内部和周围的处理工艺中,为乘客提供更舒适的环境。

【开发者分享】 利用 RQA 和 RQS 实现设计收敛

发表于:07/31/2020 , 关键词: 时序收敛, RQA, RQS, 每日头条
通过之前的博文,我们已经学会了如何使用 Report QoR Assessment (RQA) 和 Report QoR Suggestions (RQS) 来改进总体设计分析以及设计的时序收敛体验。本篇博文将通过一个具体设计示例来演示如何在实现流程中将 RQA 与 RQS 结合使用。

手把手教学如何报名Xilinx自适应计算挑战赛

发表于:07/31/2020 , 关键词: 赛灵思自适应计算挑战赛, 自适应计算, 每日头条
首届赛灵思自适应计算挑战赛(Xilinx Adaptive Computing Challenge)继续火热报名中!为了帮助国内开发者更好更快地报名成功,Xilinx技术社区帮您简化流程,手把手教您如何报名开发者比赛,赢万元大奖!

FPGA与LVDS信号兼容性分析方法

发表于:07/31/2020 , 关键词: FPGA 应用, LVDS
很多工程师在使用Xilinx开发板时都注意到了一个问题,就是开发板中将LVDS的时钟输入(1.8V电平)连接到了VCCO=2.5V或者3.3V的Bank上,于是产生了关于FPGA引脚与LVDS(以及LVDS-33,LVDS-25)信号相连时兼容性的问题,该专题就解决一下这类问题。

性能、价格、功耗的“三体问题”新解:Xilinx KU19P

发表于:07/30/2020 , 关键词: 每日头条, KU19P-FPGA
随着新一代网络被部署用来支持日益多样化的高带宽应用组合,网络供应商和数据中心运营商需要快速扩展数据包处理能力,同时最大限度地降低资本支出/运营成本,并保持灵活性,从而适应未来的连接标准。为满足未来的不同需求,赛灵思推出了Kintex UltraScale+ KU19P FPGA。

明仕彩票app冯诺依曼架构不合适了?Bittware 与 Xilinx 共推全新计算存储处理器

发表于:07/30/2020 , 关键词: BittWare, 计算存储
随着在数据驻留位置附近对数据进行处理的性能优势得到充分体现,计算存储持续受到广泛关注。行业的发展势头正在形成,存储网络工业协会 (SNIA) 等组织正在通过计算、存储器和存计划帮助定义计算存储的方式、内容、位置和原因。SNIA 帮助确定的计算存储类型之一是计算存储处理器 (CSP)

Xilinx 乘风,Vitis AI 破浪,好事成双

发表于:07/30/2020 , 关键词: Vitis-AI
随着 AI 模型所需算力发生数量级增长, AI 推断对于硬件的需求大大增加。而摩尔定律的日渐式微,让架构创新成为希望之星。只有特定领域架构(DSA)才能确保硬件可以跟上不断增长的 AI 推断需求——DSA代表着未来计算,即为“每种类型的工作负载”定制自适应硬件,以实现最高的运行效率

Xilinx 宣布加入 Open RAN 政策联盟,推动开放式 5G 网络部署

发表于:07/30/2020 , 关键词: 5G网络, O-RAN联盟, 每日头条
赛灵思今日宣布加入 Open RAN 政策联盟,致力于为Open RAN 5G 技术的开发和部署提供有力支持。Open RAN 政策联盟的成员提倡将 Open RAN 作为首选解决方案,提高多厂商生态系统的互操作性和安全性。

Xilinx 和 Aupera - 实时视频分析解决方案

发表于:07/29/2020 , 关键词: Xilinx, Aupera, 视频分析
Aupera Aup2600 系列提供了面向视频处理的模块化和分布式计算架构,打破了基于 x86 处理器的传统解决方案的瓶颈。

ADC数据接入到AXI-Steam Interface

发表于:07/29/2020 , 关键词: AXI4-Stream
如果说要在AXI、AXI-Lite、AXI-Stream中选一种最喜欢的类型,我选择Stream总线,因为这是最简单的类型,而且使用起来非常方便,五个通道就剩数据传输,就像网络通信中的TCP与UDP,UDP用起来更简洁。

Vivado中ZYNQ详解(主要用于PS和PL之间的工作衔接)

发表于:07/29/2020 , 关键词: Vivado, Zynq
AXI(Advanced extensible Interface)协议主要描述了Master设备和Slave设备之间的数据传输方式,Master设备和Slave设备之间通过握手信号建立连接。当Slave设备的数据准备好时,会发出和维持VALID信号,表示数据有效;当Master设备准备好接收数据时,会发出READY信号。数据只有在这两个信号都有效时才开始传输。

决胜HLS,算法先行-简述算法的重要性

发表于:07/29/2020 , 关键词: HLS, 高层次综合, 算法
高层次综合(High-level Synthesis)简称 HLS,指的是使用C、C++、System C 等高层次语言描述电路设计的逻辑结构,以及编写对应的测试激励,借助高层次综合工具,配合高阶约束文件及优化指令自动转换成低抽象级语言(VHDL/Verilog)描述的电路模型的过程。

【Vivado公开课】7月30日 进阶篇: 如何在Vivado下使用Tcl

发表于:07/28/2020 , 关键词: Tcl命令, Vivado公开课
本次系列研讨会将由赛灵思战略应用高级工程师 Lauren Gao(高亚军)带领大家从基础到进阶,一站式领略 Vivado 这款神奇的开发工具。

明仕彩票app如何用百度大脑FZ3深度学习卡+Paddle模型创建你的应用?

发表于:07/28/2020 , 关键词: MYD-CZU3EG, 深度学习
米尔科技的FZ3是与百度紧密合作推出的一款基于Xilinx Zynq Ultrascale CZU3EG芯片打造的深度学习计算卡,芯片内部集成了4核ARM A53处理器+GPU+FPGA的架构,具有多核心处理能力、FPGA可编程能能力以及视频流硬件解码能力等特点。

PCIe系列第七讲、PCIe的物理层

发表于:07/28/2020 , 关键词: PCIe
本章将着重讲述PCIe物理层组成与操作,物理层位于数据链路层之下,可产生PLP包(Physical Layer Packet)进行管理。
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