技术

开发者分享 | 遵循 XAPP1247 进行操作时引发回退(含屏障镜像)

发表于:06/05/2020 , 关键词: XAPP1247
XAPP1247 是对应使用屏障镜像时的多重启动 (Multiboot) 和回退 (Fallback) 的示例应用。本篇博文提供了一种屏障定时器流程测试方法以及使用此方法时可能出现问题。

【分享】以H.265 1080p 运行 Xilinx Low Latency PL DDR XV20 HDMI Video Capture and Display

发表于:06/05/2020 , 关键词: H.265
运行 Xilinx Low Latency PL DDR XV20 HDMI Video Capture and Display,可以测试HDMI输入输出,和VCU的低延时编码。Xilinx wiki的文章MPSoC VCU TRD 2019.2 - Xilinx Low Latency PL DDR XV20 HDMI Video Capture and Display以H.... 阅读详情

人工智能的发展

发表于:06/03/2020 , 关键词: 人工智能, ZCU106
得益于人工智能的发展,它在机器人、物联网和智能个人助理(如Siri和Alexa)等方面创造了惊人的发展。那什么是人工智能呢?人工智能最简单的定义是:收集有关世界的数据,并利用这些数据进行短期和长期的预测。

【分享】Linux的非对齐访问

发表于:06/02/2020 , 关键词: linux系统
Linux下,可以在设备树里保留一段内存,留给用户自己管理和使用,Linux保证不会使用保留内存。在使用中,有人发现,保留内存不能使用非对齐的方式访问。经研究,如果在保留内存时,声明了“no-map”属性,Linux会把这段内存映射为strongly order模式,不支持非对齐的方式访问。

【分享】Xilinx最新7nm器件Versal处理器列表,及Vitis能创建的模板软件工程

发表于:06/01/2020 , 关键词: Versal处理器
Xilinx的28nm、16nm SoC在业界应用非常广泛。最近也发布了7nm的SoC器件Versal VC1902和对应的开发板VCK190。Versal是新一代的异构计算平台,包含A72、R5、及内部管理用的CPU。Versal的软件开发工具是Vitis。

一文读懂时延敏感网络的调度整形机制

发表于:06/01/2020 , 关键词: 时延敏感网络
时延敏感网络(TSN, Time Sensitive Network)是指能保证时延敏感流的服务质量,实现低时延、低抖动和零丢包率的网络。时延敏感流可分为周期时延敏感流(PTS, Periodic Time Sensitive),比如工厂里的循环控制指令、同步信息,和非周期/零星时延敏感流(STS,Sporadic Time Sensitive),比如事件告警信息。

开发者分享 | RF Data Converter IP 仿真演示示例

发表于:05/29/2020 , 关键词: IP 设计
本篇博文旨在演示其构建方式及其用于实践 IP 的机制。我觉得这部分内容值得讲一讲,因为只要您能够充分理解测试激励文件,就可以将其作为有效的模板来用于将 RF Data Converter IP 构建到自己的仿真设置中。

【分享】在PL设计中使用Xilinx MPSoC EMIO GPIO,并使用脚本设置MPSoC EMIO GPIO

发表于:05/28/2020 , 关键词: MPSoC
MPSoC 为PL提供了96个GPIO,通过EMIO管脚链接到PL。普通PL设计,一般只会用到几个GPIO管脚。可以使用Vivado IPI中的Slice IP, 从其中分出指定数量的管脚。

20分钟搞定 DFX(动态功能交换)布局规划

发表于:05/27/2020 , 关键词: 动态功能交换技术, 每日头条, DFX培训
说在前面,本文分享了两个视频,从 DFX 的布局规划,再到布局规划的进阶。两个视频,20分钟帮您快速掌握 DFX 的布局规划...

Xilinx 常用 Alveo 技术文档资源列表(全中文)

发表于:05/27/2020 , 关键词: Alveo, 每日头条
随着赛灵思 Alveo 自适应计算加速卡的发布,数据中心各种工作负载开启了自适应计算加速的历程。本期小编特整理了有关 Alveo 的一批中文文档,以供各位随时下载和查阅。

【无线通信篇】你知道ASK调制吗?

发表于:05/26/2020 , 关键词: 无线通信, ASK信号
数字信号对载波信号的振幅调制称为振幅键控,即ASK。在2ASK调制系统中,数字信息只有0和1两种,所调制的载波信号的幅度变化状态也只有两种:无载波输出时代表发送0;有载波输出时代表发送1。在4ASK调制系统中,数字信息就有00、01、10、11四种,需要载波信号幅度的4个电平状态表示

【开源】竖亥:实测FPGA平台上HBM的惊人带宽!

发表于:05/25/2020 , 关键词: HBM, Alveo-U280
随着高带宽内存(HBM)的发展,FPGA正变得越来越强大,HBM 给了FPGA 更多能力去缓解再一些应用中遇到的内存带宽瓶颈和处理更多样的应用。然而,HBM 的性能表现我们了解地还不是特别精准,尤其是在 FPGA 平台上。这篇文章我们将会在HBM 的说明书和它的实际表现之间建立起桥梁

ZCU102 休眠到内存(suspend-to-ram)对DDR复位信号的设计

发表于:05/25/2020 , 关键词: ZCU102
Xilinx的开发板ZCU102支持休眠到内存(suspend-to-ram)。休眠到内存时,DDR进入自刷新,MPSoC被关电,完全不耗电。唤醒时,MPSoC根据外部输入信号判断出不是上电启动而是休眠,就从DDR读出系统状态,恢复系统

【竞赛作品分享】基于PYNQ 集群的无监督图像识别类脑计算平台 (一)

发表于:05/25/2020 , 关键词: PYNQ
本案例来源于第三届全国大学生FPGA创新设计竞赛中江南大学的OpenHEC lab团队,他们的作品基于PYNQ开源软件框架。PYNQ框架提供了完整的访问FPGA资源的Python library,通过高层次的封装,让开发者通过Python API就可以轻松调用FPGA内的模块或算法,加速产品开发部署

开发者分享 | EFuse AES 密钥验证步骤

发表于:05/22/2020 , 关键词: EFuse, 密钥管理, 每日头条
EFuse 具备一次性可编程特性,即只要使用特定密钥将“熔丝 (FUSE)”熔断,就无法再使用任何其他密钥对其进行编程。 EFuse 广泛适用于各种量产器件,在本文中我们将为大家演示一个典型情境,即客户希望向第三方供应商提供采用 AES 编程的 FPGA 的情境
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